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避免PCB設(shè)計中出現(xiàn)EMC和EMI的 9 個技巧(二)

日期:2025-04-03 14:50
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摘要: 6、EMI 屏蔽 屏蔽和濾波可以將 EMI 的影響降至*低。一些屏蔽和過濾選項包括: 組件和電路板屏蔽 物理屏蔽是封裝整個或部分電路板的金屬封裝。目標(biāo)是防止 EMI 進(jìn)入電路板的電路,具體方法因 EMI 來源而異。 對于來自系統(tǒng)內(nèi)部的 EMI,組件屏蔽可用于封裝產(chǎn)生 EMI 的特定組件,從而連接到地,減小天線環(huán)路尺寸并吸收 EMI。其他屏蔽可能會包裹整個電路板,以防止來自外部來源的 EMI。 例如,法拉第籠是一種厚厚的保護(hù)外殼,旨在阻擋射頻波。這些設(shè)備通常由金屬或?qū)щ娕菽瞥伞? ...

6、EMI 屏蔽

屏蔽和濾波可以將 EMI 的影響降至*低。一些屏蔽和過濾選項包括:

  • 組件和電路板屏蔽

物理屏蔽是封裝整個或部分電路板的金屬封裝。目標(biāo)是防止 EMI 進(jìn)入電路板的電路,具體方法因 EMI 來源而異。

對于來自系統(tǒng)內(nèi)部的 EMI,組件屏蔽可用于封裝產(chǎn)生 EMI 的特定組件,從而連接到地,減小天線環(huán)路尺寸并吸收 EMI。其他屏蔽可能會包裹整個電路板,以防止來自外部來源的 EMI。

例如,法拉第籠是一種厚厚的保護(hù)外殼,旨在阻擋射頻波。這些設(shè)備通常由金屬或?qū)щ娕菽瞥伞?/span>

  • 低通濾波

有時,PCB 可以包括低通濾波器以消除組件中的高頻噪聲。這些濾波器抑制來自這些部分的噪聲,允許電流在返回路徑上繼續(xù)而不受干擾。

  • 電纜屏蔽

傳輸模擬和數(shù)字電流的電纜會產(chǎn)生*多的 EMI 問題,屏蔽這些電纜并將它們前后接地有助于消除 EMI 干擾。

7、跟蹤路由

  • 對輸出相同但方向相反的電流信號進(jìn)行并聯(lián)布局,以消除磁干擾。

  • 應(yīng)*大限度地減少印刷引線的不連續(xù)性。例如,引線寬度不應(yīng)突然變化,引線角超過 90°。

  • EMI 大多由時鐘信號線產(chǎn)生,在走線過程中時鐘信號線應(yīng)靠近接地回路。

  • 當(dāng)涉及遠(yuǎn)離 PCB 的電線時,應(yīng)將驅(qū)動器放置在連接器旁邊。

  • 由于時鐘引線、行驅(qū)動器或總線驅(qū)動器的信號線通常承載較大的瞬態(tài)電流,因此印刷引線應(yīng)盡可能短。對于分立元件,印刷引線寬度可以達(dá)到大約 1.5mm。然而,對于 IC,印刷引線的寬度應(yīng)在 0.2mm 至 1.0mm 之間。

  • 避免在熱器件周圍或大電流流過的引線周圍使用大面積銅箔,否則產(chǎn)品長時間處于熱環(huán)境中可能會導(dǎo)致銅箔膨脹或掉落等問題。如果必須使用大面積的銅箔,*好利用柵格,這樣有利于消除銅箔與基板熱粘合產(chǎn)生的逸出氣體。

  • 焊盤中心的過孔孔徑應(yīng)適當(dāng)大于元件引腳的孔徑。如果焊盤太大,往往會產(chǎn)生干焊。

8、路由設(shè)計

為了*大限度地減少輻射干擾,應(yīng)選擇多層 PCB,內(nèi)層定義為電源層和接地層,以降低電源電路阻抗,并在信號線產(chǎn)生均勻接地層的情況下阻止公共阻抗噪聲。它通過改善信號線和接地層之間的分布電容,在阻止輻射方面發(fā)揮著關(guān)鍵作用。

  • 電源線、地線和電路板上的走線對高頻信號應(yīng)保持低阻抗。當(dāng)頻率保持如此高時,電源線、接地線和電路板走線都成為負(fù)責(zé)接收和發(fā)射干擾的小天線。為了克服這種干擾,與增加濾波電容相比,降低電源線、地線和電路板走線所具有的高頻阻抗更為重要。因此,電路板上的走線應(yīng)短而粗且排列均勻。

  • 電源線、地線和印刷走線應(yīng)適當(dāng)布置,使其短而直,以盡量減少信號線和返回線形成的環(huán)路面積。

  • 時鐘發(fā)生器應(yīng)盡可能靠近時鐘設(shè)備。

  • 石英晶體振蕩器的外殼應(yīng)接地。

  • 時鐘域應(yīng)由接地線環(huán)繞,時鐘線應(yīng)盡可能短。

  • 電路板應(yīng)采用45°而不是90°的折線,以減少高頻信號的傳輸和耦合。

  • 單層PCB和雙層PCB應(yīng)采用單點接電源和單點接地。電源線和接地線都應(yīng)盡可能粗。

  • I/O 驅(qū)動電路應(yīng)靠近電路板邊緣的連接器。

  • 關(guān)鍵線要盡量粗,兩邊要加保護(hù)地,高速線路應(yīng)短而直。

  • 組件引腳應(yīng)盡可能短,這尤其適用于去耦電容器,使用無引腳的安裝電容。

  • 對于 A/D 元件,數(shù)字部分和模擬部分的地線不能交叉。

  • 時鐘、總線和芯片選擇信號應(yīng)遠(yuǎn)離 I/O 線和連接器。

  • 模擬電壓輸入線、參考電壓端應(yīng)遠(yuǎn)離數(shù)字電路信號線,尤其是時鐘。

  • 當(dāng)時鐘線與 I/O 線垂直時,干擾比與 I/O 線平行時更小。此外,時鐘組件引腳應(yīng)遠(yuǎn)離 I/O 電纜。

  • 不應(yīng)在石英晶體或?qū)υ肼暶舾械脑O(shè)備下進(jìn)行跟蹤。

  • 切勿在弱信號電路或低頻電路周圍產(chǎn)生電流回路。

  • 任何信號都不應(yīng)該產(chǎn)生循環(huán)。如果必須安排一個循環(huán),它應(yīng)該盡可能小。

9、去藕和接地

  • 解耦設(shè)計

由電感和電容組成的低通濾波器能夠濾除高頻干擾信號。線路上的寄生電感會使供電速度變慢,從而使驅(qū)動器件的輸出電流下降。

去耦電容的適當(dāng)放置和電感電容儲能功能的應(yīng)用,使得在開關(guān)的瞬間為器件提供電流成為可能。在直流回路中,負(fù)載變化會引起電源噪聲。去耦電容配置可以阻止由于負(fù)載變化而產(chǎn)生的噪聲。

  • 接地設(shè)計

對于電子設(shè)備,接地是控制干擾的關(guān)鍵方法。如果接地與屏蔽措施正確結(jié)合,大部分干擾問題都會得到解決。

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